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參數資料
型號: MC33790DWR2
廠商: Motorola, Inc.
英文描述: Two-Channel Distributed System Interface (DSI) Physical Interface Device
中文描述: 雙通道分布式系統接口(DSI)的物理接口設備
文件頁數: 6/12頁
文件大小: 233K
代理商: MC33790DWR2
33790
6
MOTOROLA ANALOG INTEGRATED CIRCUIT DEVICE DATA
DYNAMIC ELECTRICAL CHARACTERISTICS
Characteristics noted under conditions 4.75 V
V
DD
5.25 V, 8.0 V
V
SUP
25.0 V, -40
°
C
T
J
150
°
C unless otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
MICROCONTROLLER INTERFACE
Microcontroller Signal Cycle Time
t
cyc
6.6
1000
μ
s
Microcontroller Signal Low Time
t
cycL
2.0
667
μ
s
Microcontroller Signal High Time
t
cycH
2.0
667
μ
s
Microcontroller Signal Duty Cycle for Logic Zero
DC
Lo
30
33
36
%
Microcontroller Signal Duty Cycle for Logic One
DC
Hi
60.0
66.7
72.0
%
Microcontroller Signal Slew Time (Note 5)
t
slew
500
ns
Frame Start to Signal Delay Time
t
DLY1
t
cyc
-0.1
t
cyc
t
cyc
+0.1
μ
s
Signal End to Frame End Delay Time
t
DLY2
1.0
μ
s
Rise Time (Note 5)
t
RISE
0
100
ns
Fall Time (Note 5)
t
FALL
0
100
ns
BUS TRANSMITTER
Idle to Frame and Frame to Idle Slew Rate
C
5.0 nF
t
slew(FRAME)
3.0
6.0
10.0
V/
μ
s
Signal High to Low and Signal Low to High Slew Rate
C
5.0 nF
t
slew(SIGNAL)
3.0
4.5
8.0
V/
μ
s
Data Valid (V
SUPx
= 25 V, C
L
5.0 nF)
DSIxF, V
IN(TH)
to DSIxO = 5.3 V
DSIxS, V
IN(TH)
to DSIxO = 2.6 V
DSIxS, V
IN(TH)
to DSIxO = 3.4 V
DSIxF, V
IN(TH)
to DSIxO = 7.0 V
t
DVLD1
t
DVLD2
t
DVLD3
t
DVLD4
2.44
0.25
0.25
0.25
6.56
1.3
1.3
1.3
μ
s
BUS RECEIVER
Receiver Delay Time
I = 9.0 mA to DSIxR = 0.8
*
V
DD
I = -1.0 mA to DSIxR = 0.2
*
V
DD
t
DRH
t
DRL
400
400
750
750
ns
Notes
5.
Slew times and rise and fall times between 10% and 90% of output high and low levels.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述
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