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參數資料
| 型號： | MC908QL4DW |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數： | 98/222頁 |
| 文件大小： | 2861K |
| 代理商： | MC908QL4DW |
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Low-Voltage Inhibit (LVI)
MC68HC908QL4 MC68HC908QL3 MC68HC908QL2 Data Sheet, Rev. 4
98
Freescale Semiconductor
The LVI module contains a bandgap reference circuit and comparator. When the LVITRIP bit is cleared,
the default state at power-on reset, V
TRIPF
is configured for the lower V
DD
operating range. The actual
trip points are specified in
17.5 5-V DC Electrical Characteristics
and
17.8 3.3-V DC Electrical
Characteristics
.
Because the default LVI trip point after power-on reset is configured for low voltage operation, a system
requiring high voltage LVI operation must set the LVITRIP bit during system initialization. V
DD
must be
above the LVI trip rising voltage, V
TRIPR
, for the high voltage operating range or the MCU will immediately
go into LVI reset.
After an LVI reset occurs, the MCU remains in reset until V
DD
rises above V
TRIPR
. See
Chapter 13 System
Integration Module (SIM)
for the reset recovery sequence.
The output of the comparator controls the state of the LVIOUT flag in the LVI status register (LVISR) and
can be used for polling LVI operation when the LVI reset is disabled.
The LVI is enabled out of reset. The following bits located in the configuration register can alter the default
conditions.
Setting the LVI power disable bit, LVIPWRD, disables the LVI.
Setting the LVI reset disable bit, LVIRSTD, prevents the LVI module from generating a reset.
Setting the LVI enable in stop mode bit, LVISTOP, enables the LVI to operate in stop mode.
Setting the LVI trip point bit, LVITRIP, configures the trip point voltage (V
TRIPF
) for the higher V
DD
operating range.
10.3.1 Polled LVI Operation
In applications that can operate at V
DD
levels below the V
TRIPF
level, software can monitor V
DD
by polling
the LVIOUT bit. In the configuration register, LVIPWRD must be cleared to enable the LVI module, and
LVIRSTD must be set to disable LVI resets.
10.3.2 Forced Reset Operation
In applications that require V
DD
to remain above the V
TRIPF
level, enabling LVI resets allows the LVI
module to reset the MCU when V
DD
falls below the V
TRIPF
level. In the configuration register, LVIPWRD
and LVIRSTD must be cleared to enable the LVI module and to enable LVI resets.
10.3.3 LVI Hysteresis
The LVI has hysteresis to maintain a stable operating condition. After the LVI has triggered (by having
V
DD
fall below V
TRIPF
), the MCU will remain in reset until V
DD
rises above the rising trip point voltage,
V
TRIPR
. This prevents a condition in which the MCU is continually entering and exiting reset if V
DD
is
approximately equal to V
TRIPF
. V
TRIPR
is greater than V
TRIPF
by the typical hysteresis voltage, V
HYS
.
10.3.4 LVI Trip Selection
LVITRIP in the configuration register selects the LVI protection range. The default setting out of reset is
for the low voltage range. Because LVITRIP is in a write-once configuration register, the protection range
cannot be changed after initialization.
NOTE
The MCU is guaranteed to operate at a minimum supply voltage. The trip
point (V
TRIPF
) may be lower than this. See
Chapter 17 Electrical
Specifications
for the actual trip point voltages.
相關PDF資料 |
PDF描述 |
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| MC908QL4M | Microcontrollers |
| MC908QL4V | Microcontrollers |
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相關代理商/技術參數 |
參數描述 |
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| MC908QL4MDTE | 功能描述:8位微控制器 -MCU NITRON LINE EPP RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| MC908QL4MDTE | 制造商:Freescale Semiconductor 功能描述:Microcontroller |
| MC908QL4MDTER | 功能描述:8位微控制器 -MCU NITRON LINE EPP RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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