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參數資料
| 型號： | MC68HC912DT128A |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁數： | 206/404頁 |
| 文件大小： | 2141K |
| 代理商： | MC68HC912DT128A |
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Enhanced Capture Timer
MC68HC912DT128A Rev 2.0
206
Enhanced Capture Timer
MOTOROLA
Depending on the TIOS bit for the corresponding channel, these
registers are used to latch the value of the free-running counter when a
defined transition is sensed by the corresponding input capture edge
detector or to trigger an output action for output compare.
Read anytime. Write anytime for output compare function. Writes to
these registers have no meaning or effect during input capture. All timer
input capture/output compare registers are reset to $0000.
16-Bit Pulse Accumulator A (PACA) is formed by cascading the 8-bit
pulse accumulators PAC3 and PAC2.
When PAEN is set, the PACA is enabled. The PACA shares the input pin
with IC7.
Read: any time
Write: any time
TC4
—
Timer Input Capture/Output Compare Register 4
$0098
–
$0099
Bit 7
Bit 15
Bit 7
6
14
6
5
4
12
4
3
2
10
2
1
9
1
Bit 0
Bit 8
Bit 0
13
5
11
3
TC5
—
Timer Input Capture/Output Compare Register 5
$009A
–
$009B
Bit 7
Bit 15
Bit 7
6
14
6
5
4
12
4
3
2
10
2
1
9
1
Bit 0
Bit 8
Bit 0
13
5
11
3
TC6
—
Timer Input Capture/Output Compare Register 6
$009C
–
$009D
Bit 7
Bit 15
Bit 7
6
14
6
5
13
5
4
3
2
1
9
1
Bit 0
Bit 8
Bit 0
12
4
11
3
10
2
TC7
—
Timer Input Capture/Output Compare Register 7
$009E
–
$009F
Bit 7
Bit 15
Bit 7
6
14
6
5
13
5
4
3
2
1
9
1
Bit 0
Bit 8
Bit 0
12
4
11
3
10
2
PACTL
—
16-Bit Pulse Accumulator A Control Register
$00A0
BIT 7
0
0
6
5
4
3
2
1
BIT 0
PAI
0
PAEN
0
PAMOD
0
PEDGE
0
CLK1
0
CLK0
0
PAOVI
0
RESET:
20-ect
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PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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