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參數資料
型號: MC68HC912DT128A
廠商: Motorola, Inc.
英文描述: microcontroller unit 16BIT DEVICE
中文描述: 16位微控制器裝置
文件頁數: 299/404頁
文件大小: 2141K
代理商: MC68HC912DT128A
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MSCAN Controller
Programmer
s Model of Control Registers
MC68HC912DT128A Rev 2.0
MOTOROLA
MSCAN Controller
299
31-mscan12
0 = One sample per bit.
1 = Three samples per bit
1
.
TSEG22
TSEG10
Time Segment
Time segments within the bit time fix the number of clock cycles per
bit time, and the location of the sample point.
Time segment 1 (TSEG1) and time segment 2 (TSEG2) are
programmable as shown in
Table 44
.
The bit time is determined by the oscillator frequency, the baud rate
prescaler, and the number of time quanta (Tq) clock cycles per bit (as
shown above).
NOTE:
The CBTR1 register can only be written if the SFTRES bit in CMCR0 is
set.
msCAN12
Receiver Flag
Register (CRFLG)
All bits of this register are read and clear only. A flag can be cleared by
writing a 1 to the corresponding bit position. A flag can only be cleared
when the condition which caused the setting is no more valid. Writing a
1. In this case PHASE_SEG1 must be at least 2 TimeQuanta.
Table 43 Time segment syntax
SYNC_SEG
System expects transitions to occur on the bus during this period.
A node in transmit mode will transfer a new value to the CAN bus at
this point.
A node in receive mode will sample the bus at this point. If the three
samples per bit option is selected then this point marks the position
of the third sample.
Transmit point
Sample point
Table 44 Time segment values
TSEG13 TSEG12 TSEG11 TSEG10
0
0
0
0
0
0
0
0
.
.
.
.
1
1
Time segment 1
1 Tq clock cycle
2 Tq clock cycles
3 Tq clock cycles
4 Tq clock cycles
.
.
16 Tq clock cycles
TSEG22 TSEG21 TSEG20
0
0
0
0
.
.
.
.
1
1
Time segment 2
1 Tq clock cycle
2 Tq clock cycles
.
.
8 Tq clock cycles
0
0
1
1
.
.
1
0
1
0
1
.
.
1
0
1
.
.
1
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PDF描述
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參數描述
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