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參數資料
| 型號： | MC908QL4M |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數： | 125/222頁 |
| 文件大小： | 2861K |
| 代理商： | MC908QL4M |
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Exception Control
MC68HC908QL4 MC68HC908QL3 MC68HC908QL2 Data Sheet, Rev. 4
Freescale Semiconductor
125
Interrupts are latched, and arbitration is performed in the SIM at the start of interrupt processing. The
arbitration result is a constant that the CPU uses to determine which vector to fetch. Once an interrupt is
latched by the SIM, no other interrupt can take precedence, regardless of priority, until the latched
interrupt is serviced (or the I bit is cleared).
At the beginning of an interrupt, the CPU saves the CPU register contents on the stack and sets the
interrupt mask (I bit) to prevent additional interrupts. At the end of an interrupt, the RTI instruction recovers
the CPU register contents from the stack so that normal processing can resume.
Figure 13-8
shows
interrupt entry timing.
Figure 13-9
shows interrupt recovery timing.
Figure 13-8
.
Interrupt Entry
Figure 13-9. Interrupt Recovery
MODULE
INTERRUPT
DATA BUS
R/W
DUMMY
SP
SP – 1
SP – 2
SP – 3
SP – 4
VECT H
VECT L
START ADDR
ADDRESS BUS
DUMMY
PC – 1[7:0] PC – 1[15:8]
X
A
CCR
V DATA H
V DATA L
OPCODE
I BIT
MODULE
INTERRUPT
DATA BUS
R/W
SP – 4
SP – 3
SP – 2
SP – 1
SP
PC
PC + 1
ADDRESS BUS
CCR
A
X
PC – 1[7:0] PC – 1[15:8] OPCODE
OPERAND
I BIT
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PDF描述 |
|---|---|
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參數描述 |
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