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參數(shù)資料
| 型號(hào)： | MC912DG128A |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁(yè)數(shù)： | 199/404頁(yè) |
| 文件大小： | 2141K |
| 代理商： | MC912DG128A |
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Enhanced Capture Timer
Timer Register Descriptions
MC68HC912DT128A Rev 2.0
MOTOROLA
Enhanced Capture Timer
199
13-ect
When the OC7Mn bit is set, a successful OC7 action will override a
successful OC[6:0] compare action during the same cycle; therefore, the
OCn action taken will depend on the corresponding OC7D bit.
The 16-bit main timer is an up counter.
A full access for the counter register should take place in one clock cycle.
A separate read/write for high byte and low byte will give a different result
than accessing them as a word.
Read anytime.
Write has no meaning or effect in the normal mode; only writable in
special modes (SMODN = 0).
The period of the first count after a write to the TCNT registers may be a
different size because the write is not synchronized with the prescaler
clock.
Read or write anytime.
TEN
—
Timer Enable
0 = Disables the main timer, including the counter. Can be used for
reducing power consumption.
1 = Allows the timer to function normally.
If for any reason the timer is not active, there is no
÷
64 clock for the
pulse accumulator since the E
÷
64 is generated by the timer prescaler.
TCNT
—
Timer Count Register
$0084
–
$0085
Bit 7
Bit 15
Bit 7
0
6
5
4
3
2
1
9
1
0
Bit 0
Bit 8
Bit 0
0
14
6
0
13
5
0
12
4
0
11
3
0
10
2
0
RESET:
TSCR
—
Timer System Control Register
$0086
Bit 7
TEN
0
6
5
4
3
2
1
Bit 0
TSWAI
0
TSBCK
0
TFFCA
0
RESET:
0
0
0
0
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參數(shù)描述 |
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