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參數資料
| 型號： | MC912DG128A |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁數： | 252/404頁 |
| 文件大小： | 2141K |
| 代理商： | MC912DG128A |
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Inter-IC Bus
MC68HC912DT128A Rev 2.0
252
Inter-IC Bus
MOTOROLA
bit, which is signalled from the receiving device by pulling the SDA low
at the ninth clock. So one complete data byte transfer needs nine clock
pulses.
If the slave receiver does not acknowledge the master, the SDA line
must be left high by the slave. The master can then generate a stop
signal to abort the data transfer or a start signal (repeated start) to
commence a new calling.
If the master receiver does not acknowledge the slave transmitter after
a byte transmission, it means
’
end of data
’
to the slave, so the slave
releases the SDA line for the master to generate STOP or START signal.
STOP Signal
The master can terminate the communication by generating a STOP
signal to free the bus. However, the master may generate a START
signal followed by a calling command without generating a STOP signal
first. This is called repeated START. A STOP signal is defined as a
low-to-high transition of SDA while SCL at logical
“
1
”
(see
Figure 38
).
The master can generate a STOP even if the slave has generated an
acknowledge at which point the slave must release the bus.
Repeated START
Signal
As shown in
Figure 38
, a repeated START signal is a START signal
generated without first generating a STOP signal to terminate the
communication. This is used by the master to communicate with another
slave or with the same slave in different mode (transmit/receive mode)
without releasing the bus.
Arbitration
Procedure
IIC is a true multi-master bus that allows more than one master to be
connected on it. If two or more masters try to control the bus at the same
time, a clock synchronization procedure determines the bus clock, for
which the low period is equal to the longest clock low period and the high
is equal to the shortest one among the masters. The relative priority of
the contending masters is determined by a data arbitration procedure, a
bus master loses arbitration if it transmits logic
“
1
”
while another master
transmits logic
“
0
”
. The losing masters immediately switch over to slave
receive mode and stop driving SDA output. In this case the transition
6-iicbus
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC912DT128A | microcontroller unit 16BIT DEVICE |
| MC92052 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC912DG128ACPVE | 功能描述:16位微控制器 - MCU 16 BIT MICROCONTR W/SGF RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數據總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| MC912DG128ACPVE | 制造商:Freescale Semiconductor 功能描述:16-BIT MICROCONTROLLER IC |
| MC912DG128ACPVER | 功能描述:16位微控制器 - MCU 16 BIT MICROCONTR W/SGF RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數據總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| MC912DG128ACPVR2 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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