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參數(shù)資料
| 型號(hào)： | MC912DG128A |
| 廠商： | Motorola, Inc. |
| 英文描述： | microcontroller unit 16BIT DEVICE |
| 中文描述： | 16位微控制器裝置 |
| 文件頁(yè)數(shù)： | 216/404頁(yè) |
| 文件大小： | 2141K |
| 代理商： | MC912DG128A |
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Enhanced Capture Timer
MC68HC912DT128A Rev 2.0
216
Enhanced Capture Timer
MOTOROLA
0 = Queue Mode of Input Capture is enabled.
The main timer value is memorized in the IC register by a valid
input pin transition.
With a new occurrence of a capture, the value of the IC register
will be transferred to its holding register and the IC register
memorizes the new timer value.
1 = Latch Mode is enabled. Latching function occurs when
modulus down-counter reaches zero or a zero is written into
the count register MCCNT (see
Buffered IC Channels
).
With a latching event the contents of IC registers and 8-bit
pulse accumulators are transferred to their holding registers.
8-bit pulse accumulators are cleared.
Read: any time
Write: only in special mode (SMOD = 1).
TCBYP
—
Main Timer Divider Chain Bypass
0 = Normal operation
1 = For testing only. The 16-bit free-running timer counter is divided
into two 8-bit halves and the prescaler is bypassed. The clock
drives both halves directly.
When the high byte of timer counter TCNT ($84) overflows
from $FF to $00, the TOF flag in TFLG2 ($8F) will be set.
Read: any time (inputs return pin level; outputs return data register
contents)
TIMTST
—
Timer Test Register
$00AD
BIT 7
0
0
6
0
0
5
0
0
4
0
0
3
0
0
2
0
0
1
BIT 0
0
0
TCBYP
0
RESET:
PORTT
—
Timer Port Data Register
$00AE
BIT 7
PT7
I/OC7
-
6
5
4
3
2
1
BIT 0
PT0
I/OC0
-
PORT
TIMER
RESET:
PT6
I/OC6
-
PT5
I/OC5
-
PT4
I/OC4
-
PT3
I/OC3
-
PT2
I/OC2
-
PT1
I/OC1
-
30-ect
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| MC912DG128ACPVE | 制造商:Freescale Semiconductor 功能描述:16-BIT MICROCONTROLLER IC |
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| MC912DG128ACPVR2 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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