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參數(shù)資料
型號: MC92600
廠商: Motorola, Inc.
英文描述: High-speed, Full-duplex, Serial Data Interface(高速全雙工串行數(shù)據(jù)接口)
中文描述: 高速,全雙工,串行數(shù)據(jù)接口(高速全雙工串行數(shù)據(jù)接口)
文件頁數(shù): 25/82頁
文件大小: 1056K
代理商: MC92600
Chapter 3. WarpLink Receiver
3-3
WarpLink Receiver Interface Signals
Table 3-1. WarpLink Receiver Interface Signals
Signal Name
Description
Function
Direction
Active
State
RECV_n_7 through
RECV_n_0
Received byte (bits 7D0) Received and decoded data/control
byte.
The least signiTcant 8 bits of received
coded data in TBI mode.
Output
RECV_n_K
Special data indicator/
Received bit 8
Indicates that received byte is a special
control byte.
Received coded bit 8 in TBI mode.
Errors are coded using this signal. See
Section 3.7 for error codes.
Output
RECV_n_9
Received bit 9
Received coded bit 9 in TBI mode.
Unused in 8-bit mode.
Output
RECV_n_IDLE
Receiver idle detect
Indicates that the receiver detected an
idle character (operates in Byte and
TBI modes).
Errors are coded using this signal. See
Section 3.7 for error codes.
Output
RECV_n_ERR
Receiver error
Indicates that the receiver detected an
error. RECV_n_IDLE and RECV_n_K
must be decoded to determine error
condition. See Section 3.7 for error
codes.
Output
RECV_n_RCLK
Receiver recovered
Byte clock
Internally generated clock used for
reading receiver outputs when RCCE
is asserted.
Output
WSE_GEN
Word synchronization
Event generate
This signal when asserted coincident
with XMIT_n_K set low on all four links
invalidates current byte alignment and
word synchronization.
This signal also affects transmitter
operation. See Section 2.2.
Input
XMIT_n_K
Special data indicator
This signal when set low on all four
links coincident with WSE_GEN
asserted invalidates current byte
alignment and word synchronization.
This signal also affects transmitter
operation. See Section 2.2.
Input
TBIE
10-bit interface enable
Indicates that the receiver interface is
in 10-bit mode and that the 8B/10B
decoder is bypassed.
Input
High
HSE
half-speed enable
Indicates to operate link at half-speed.
Both data and link interfaces run at half
speed.
Input
High
WSE
Word synchronization
enable
Indicates that all four receivers are
being used in unison to receive
synchronized data.
Input
High
相關(guān)PDF資料
PDF描述
MC9S12DB128B MC9S12DT128B
MC9S12DB128BCFU MC9S12DT128B
MC9S12DB128BCPV MC9S12DT128B
MC9S12DB128BMFU MC9S12DT128B
MC9S12DB128BMPV MC9S12DT128B
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參數(shù)描述
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MC92600VMB 制造商:Freescale Semiconductor 功能描述:
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