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參數資料
| 型號： | MC92600 |
| 廠商： | Motorola, Inc. |
| 英文描述： | High-speed, Full-duplex, Serial Data Interface(高速全雙工串行數據接口) |
| 中文描述： | 高速，全雙工，串行數據接口（高速全雙工串行數據接口） |
| 文件頁數： | 42/82頁 |
| 文件大小： | 1056K |
| 代理商： | MC92600 |
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4-4
MC92600 WarpLink Users Manual
Repeater Mode
source and re-establishing synchronization. All word synchronization modes are supported
in repeater mode.
Similar to byte alignment, the word synchronization sequence must be repeated twice, once
for the repeater and once for the destinations receiver. If the 4 idle/1 non-idle word
synchronization event mode is being used, a 4 idle/1 non-idle word synchronization event
must be followed by a second 4 idle/1 non-idle word synchronization event to enable the
entire link to establish word synchronization. Note that byte alignment must be established
prior to word synchronization. See Section 4.3.2, òByte Alignment Modeó on page 4-3.
4.3.4 Recovered Clock Mode
The WarpLink Quads four transmitters are timed exclusively to the reference clock
domain. Recovered clock mode cannot be used in repeater mode. The setting on the
recovered clock enable input, RCCE, is ignored when in repeater mode and all data is timed
to the reference clock.
4.3.5 Add/Drop Idle Mode
Repeater mode is timed exclusively to the reference clock domain as stated above. A
frequency offset between the source transmitter and the repeater will cause the repeaters
receiver to eventually overrun/underrun. To ensure that overrun/underrun does not cause
data to be lost, add/drop idle mode must be used. Add/drop idle mode is enabled by setting
ADIE high. The repeater adds or drops idles from the data stream to maintain alignment to
the reference clock. The guidelines for idle density are discussed in Section 3.4.2,
òReference Clock Mode.ó
4.3.6 Half-Speed Mode, Double Data Rate Mode
Half-speed mode and double data rate mode simply affect the frequency of the reference
clock that must be provided and the timing of the receiver interface. All combinations of
these modes are supported in repeater mode. See Section 3.5.4.4, òHalf-Speed Modeó for
more information on half-speed mode and Section 3.5.4.3, òDouble Data Rate Modeó for
more information on double data rate mode.
相關PDF資料 |
PDF描述 |
|---|---|
| MC9S12DB128B | MC9S12DT128B |
| MC9S12DB128BCFU | MC9S12DT128B |
| MC9S12DB128BCPV | MC9S12DT128B |
| MC9S12DB128BMFU | MC9S12DT128B |
| MC9S12DB128BMPV | MC9S12DT128B |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| MC92603VM | 功能描述:IC ETH TXRX QUAD GIG 256-MAPBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅動器，接收器，收發器 系列:- 標準包裝:1,000 系列:- 類型:收發器 驅動器/接收器數:2/2 規程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.295"，7.50mm 寬） 供應商設備封裝:16-SOIC 包裝:帶卷 (TR) |
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